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福建阻焊油墨光刻膠廠家

來源: 發布時間:2025-06-19

納米壓印光刻膠


  • 微納光學器件制造:制作衍射光學元件、微透鏡陣列等微納光學器件時,納米壓印光刻膠可實現高精度的微納結構復制。通過納米壓印技術,將模板上的微納圖案轉移到光刻膠上,再經過后續處理,可制造出具有特定光學性能的微納光學器件,應用于光通信、光學成像等領域。
  • 生物芯片制造:在 DNA 芯片、蛋白質芯片等生物芯片的制造中,需要在芯片表面構建高精度的微納結構,用于生物分子的固定和檢測。納米壓印光刻膠可幫助實現這些精細結構的制作,提高生物芯片的檢測靈敏度和準確性。

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    廣東吉田半導體材料有限公司多種光刻膠產品,主要涵蓋厚板、負性、正性、納米壓印及光刻膠等類別,以滿足不同領域的需求。

    厚板光刻膠:JT-3001 型號,具有優異的分辨率和感光度,抗深蝕刻性能良好,符合歐盟 ROHS 標準,保質期 1 年。適用于對精度和抗蝕刻要求高的厚板光刻工藝,如特定電路板制造。

    負性光刻膠

    • SU-3 負性光刻膠:分辨率優異,對比度良好,曝光靈敏度高,光源適應,重量 100g。常用于對曝光精度和光源適應性要求較高的微納加工、半導體制造等領域。


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    • LCD 正性光刻膠 YK-200:具有較大曝光、高分辨率、良好涂布和附著力,重量 100g。適用于液晶顯示領域的光刻工藝,確保 LCD 生產中圖形精確轉移和良好涂布效果。
    • 半導體正性光刻膠 YK-300:具備耐熱耐酸、耐溶劑性、絕緣阻抗和緊密性,重量 100g。主要用于半導體制造工藝,滿足半導體器件對光刻膠在化學穩定性和電氣性能方面的要求。
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    主要應用場景

     印刷電路板(PCB):

    ? 通孔/線路加工:負性膠厚度可達20-50μm,耐堿性蝕刻液(如氯化鐵、堿性氯化銅),適合制作大尺寸線路(線寬/線距≥50μm),如雙面板、多層板的外層電路。

    ? 阻焊層:作為絕緣保護層,覆蓋非焊盤區域,需厚膠(50-100μm)和高耐焊接溫度(260℃以上),負性膠因工藝簡單、成本低而廣泛應用。

     微機電系統(MEMS):

    ? 深硅蝕刻(DRIE):負性膠作為蝕刻掩膜,厚度可達100μm以上,耐SF?等強腐蝕性氣體,用于制作加速度計、陀螺儀的高深寬比結構(深寬比>20:1)。

    ? 模具制造:在硅或玻璃基板上制作微流控芯片的通道模具,利用負性膠的厚膠成型能力。

     平板顯示(LCD):

    ? 彩色濾光片(CF)基板預處理:在玻璃基板上制作絕緣層或緩沖層,耐濕法蝕刻(如HF溶液),確保后續RGB色阻層的精確涂布。

     功率半導體與分立器件:

    ? IGBT、MOSFET的隔離區蝕刻:負性膠用于制作較寬的隔離溝槽(寬度>10μm),耐高濃度酸堿蝕刻,降低工藝成本。

    國際標準與客戶認證
    公司通過ISO9001、ISO14001等認證,并嚴格執行8S現場管理,生產環境潔凈度達Class 10級。其光刻膠產品已通過京東方、TCL華星的供應商認證,在顯示面板領域的市占率約5%,成為本土企業中少數能與日本JSR、德國默克競爭的廠商。

    全流程可追溯體系
    吉田半導體建立了從原材料入庫到成品出庫的全流程追溯系統,關鍵批次數據(如樹脂分子量分布、光敏劑純度)實時上傳云端,確保產品一致性和可追溯性。這一體系使其在車規級芯片等對可靠性要求極高的領域獲得突破,2023年車用光刻膠銷售額同比增長120%。
    聚焦封裝需求,吉田公司提供從光刻膠到配套材料的一姑式服務。

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    國家大基金三期:注冊資本3440億元,明確將光刻膠列為重點投資領域,計劃投入超500億元支持樹脂、光引發劑等原料研發,相當于前兩期投入總和的3倍。

    地方專項政策:湖北省對通過驗證的光刻膠企業給予設備采購補貼+稅收減免,武漢太紫微憑借全流程國產化技術獲中芯國際百萬級訂單;福建省提出2030年化工新材料自給率達90%,光刻膠是重點突破方向。

    研發專項:科技部“雙十計劃”設立20億元經費,要求2025年KrF/ArF光刻膠國產化率突破10%,并啟動EUV光刻膠預研。
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    ? 化學反應:

    ? 正性膠:曝光后光敏劑(如重氮醌DQN)分解,生成羧酸,在堿性顯影液中溶解;

    ? 負性膠:曝光后光敏劑引發交聯劑與樹脂形成不溶性網狀結構。

    5. 顯影(Development)

    ? 顯影液:

    ? 正性膠:堿性水溶液(如0.26N四甲基氫氧化銨TMAH),溶解曝光區域;

    ? 負性膠:有機溶劑(如二甲苯、醋酸丁酯),溶解未曝光區域。

    ? 方法:噴淋顯影(PCB)或沉浸式顯影(半導體),時間30秒-2分鐘,需控制顯影液濃度和溫度。

    6. 后烘(Post-Bake)

    ? 目的:固化膠膜,提升耐蝕刻性和熱穩定性。

    ? 條件:

    ? 溫度:100-150℃(半導體用正性膠可能更高,如180℃);

    ? 時間:15-60分鐘(厚膠或高耐蝕需求時延長)。

    7. 蝕刻/離子注入(后續工藝)

    ? 蝕刻:以膠膜為掩膜,通過濕法(酸堿溶液)或干法(等離子體)刻蝕基板材料(如硅、金屬、玻璃);

    ? 離子注入:膠膜保護未曝光區域,使雜質離子只能注入曝光區域(半導體摻雜工藝)。

    8. 去膠(Strip)

    ? 方法:

    ? 濕法去膠:強氧化劑(如硫酸+雙氧水)或有機溶劑(如N-甲基吡咯烷酮NMP);

    ? 干法去膠:氧等離子體灰化(半導體領域,無殘留)。

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